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liximomo
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liximomo
4年前更新
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基于FPGA的扩频通信系统设计（附matlab和verilog代码）
导读在无线通信系统中，普遍使用扩频通信技术，因此扩频技术对通信系统具有重要的现实意义。直接序列扩频技术是应用最广的一种扩...
+41
Altera-Intel
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liximomo
4年前更新
542次阅读
关注
基于 FPGA 的模拟 I²C协议设计（附verilog代码）
导读
I²C（Inter-Integrated Circuit），其实是 I²C Bus简称，中文就是集成电路总线，它是一种串行通信总线，使用多主从架构，...
+18
FPGA常见问题
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liximomo
4年前更新
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Vivado调试小结：ILA debug中的数据也许并不可信
FPGA的调试是个很蛋疼的事，即便Vivado已经比ISE好用了很多，但调试起来依旧蛋疼。即便是同一个程序，FPGA每次重新综合、实现后结果都多多少少会有所不同。而且加入到ila中的数据会占用RAM资源，影响布局布线的结果。
尤其是在时序紧张的情况下，ila...
Xilinx-AMD
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liximomo
3年前更新
30次阅读
关注
FPGA：数字电路简介
文章目录 数字电路的历史 电子管时代 晶体管时代 半导体集成电路IC 时代 IC的发展阶段 EDA (Electronics Design Automation) 技...
FPGA常见问题
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liximomo
3年前更新
68次阅读
关注
FPGA做正则匹配和网络安全，究竟有多大的优势？
网络安全已经被提升为国家战略的高度，高校里面的新增的一级学科，前几年，中央网信办、教育部公布了“一流网络安全学院建设示范...
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FPGA新闻资讯
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liximomo
4年前更新
46次阅读
关注
fpga实操训练（vga测试）
【 声明：版权所有，欢迎转载，请勿用于商业用途。 联系信箱：feixiaoxing @163.com】我自己读书那会，买的电脑还是以台式机居...
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FPGA常见问题
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liximomo
4年前更新
62次阅读
关注
大家一致避免使用的锁存器为什么依然存在于FPGA中？我们对锁存器有什么误解？
前言
在FPGA的设计中，避免使用锁存器是几乎所有FPGA工程师的共识，Xilinx和Altera也在手册中提示大家要慎用锁存器，除非你...
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Xilinx-AMD
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liximomo
4年前更新
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FPGA时序约束理论篇之IO约束
I/O约束
I/O约束是必须要用的约束，又包括管脚约束和延迟约束。
管脚约束
管脚约束就是指管脚分配，我们要指定管脚的PAC...
Xilinx-AMD
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liximomo
4年前更新
54次阅读
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FPGA时序约束实战篇之伪路径约束
伪路径约束 在本章节的“2 约束主时钟”一节中，我们看到在不加时序约束时，Timing Report会提示很多的error，其中就有跨时...
Xilinx-AMD
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liximomo
4年前更新
43次阅读
关注
FPGA时序约束实战篇之多周期路径约束
多周期路径约束 多周期路径，我们一般按照以下4个步骤来约束：带有使能的数据 首先来看带有使能的数据，在本工程中的Tmi...
Xilinx-AMD
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liximomo
4年前更新
25次阅读
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FPGA时序约束实战篇之延迟约束
延迟约束 对于延迟约束，相信很多同学是不怎么用的，主要可能就是不熟悉这个约束，也有的是嫌麻烦，因为有时还要计算PCB上...
Xilinx-AMD
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liximomo
4年前更新
52次阅读
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FPGA时序约束之Vivado辅助工具
时序约束辅助工具
上面我们讲的都是xdc文件的方式进行时序约束，Vivado中还提供了两种图形界面的方式，帮我们进行时序约束：...
Xilinx-AMD
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