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geekdechao
他很忙，正在debug...
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geekdechao
7年前发布
92次阅读
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请教一个问题，lattice IP Server上的IP下载下来配置后会报错，是因为没有IP license吗？
如题，
Lattice-莱迪斯
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geekdechao
4年前更新
38次阅读
关注
汽车芯片新“混战”
消费电子市场的疲软，给持续了近2年的“缺芯潮”按下了暂停键。
当前，市场已经从前期的全面缺芯，向结构性缺芯的态势转移，即以...
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FPGA新闻资讯
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geekdechao
4年前更新
34次阅读
关注
AMD 推出 AU7P FPGA 和 ZU3T 自适应 SoC
Romisaa SamhoudAMD 产品线经理随着 Zynq® UltraScale+™ MPSoC 和 Artix® UltraScale+ FPGA 取得成功，AMD 现推出两款全新器...
FPGA新闻资讯
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geekdechao
4年前更新
12次阅读
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AMD Xilinx 亮相 2022 中国国际通信博览会
加速 5G-A/6G 的网络创新与商业成功 AMD Xilinx 为网络中的有线和无线网络设备提供了可靠的可编程器件。得益于 FPGA 产...
FPGA新闻资讯
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geekdechao
4年前更新
412次阅读
关注
linux vivado安装时卡在最后一步解决方案
在ubuntu上安装vivado2021.1时，一直卡在最后一步：generating installed device list
安装其他版本也出现过该问题。
image-2022...
Xilinx-AMD
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geekdechao
4年前更新
52次阅读
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Hold Time违例，该如何解决
首先，我们要知道的是，Hold Time违例，是因为时钟绕的太远，到达时间太晚。而且综合之后给出的时序报告都是估计值，因此综合...
Xilinx-AMD
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geekdechao
4年前更新
88次阅读
关注
Xilinx FPGA 工具Vivado时序收敛技术（一） Baseline基础理论
本文整理自Xilinx公开课：Vivado时序收敛技术。
有些知识在公开课中讲的并不是很细，因此我又对齐进行了整理，分为了几篇文章。
...
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Xilinx-AMD
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geekdechao
4年前更新
61次阅读
关注
FPGA时序约束之Tcl命令的对象及属性
Vivado时序约束中Tcl命令的对象及属性 在前面的章节中，我们用了很多Tcl的指令，但有些指令并没有把所有的参数多列出来解释，...
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Xilinx-AMD
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geekdechao
4年前更新
26次阅读
关注
FPGA时序约束之Vivado辅助工具
时序约束辅助工具
上面我们讲的都是xdc文件的方式进行时序约束，Vivado中还提供了两种图形界面的方式，帮我们进行时序约束：...
Xilinx-AMD
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geekdechao
4年前更新
49次阅读
关注
影响FPGA时序的进位链（Carry Chain）， 你用对了么？？
在FPGA中我们写的最多的逻辑是什么？相信对大部分朋友来说应该都是计数器，从最初板卡的测试时我们会闪烁LED，到复杂的AXI总...
Xilinx-AMD
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geekdechao
4年前更新
98次阅读
关注
如何使用Git进行Vivado工程的管理
git有多好用我就不用多说了，可谓是程序员必备技能之一。对于一般的软件代码来说，只需把源文件进行git管理即可。但对于FP...
+3
Xilinx-AMD
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geekdechao
4年前更新
64次阅读
关注
几组实用FPGA原理设计图
FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它...
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FPGA常见问题
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