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ttest
3年前更新
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使用LPM实现FIFO（wrusedw和rdusedw及其解释）
仿真的前一部分如下：
注意读和写采用的是不同的clk。以上截图主要是写的部分，两个usedw表示已经 写入FIFO数的数据个数，在写入...
Altera-Intel
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ttest
8年前发布
78次阅读
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LATTICE器件’pmi_distributed_dpramEbnonen13664pb769e9c’ is unexpanded. 这个错误怎么解决？
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Lattice-莱迪斯
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ttest
7年前发布
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LATTICE ECP5 FPGA 使用clarity生成DDR3或其它IP的操作步骤分享
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Lattice-莱迪斯
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ttest
4年前更新
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Dell’Oro_Group发布报告：在这个优势领域，华为依旧是全球第一
10月8日市场研究公司Dell'Oro Group正式发布了2022年上半年全球电信设备市场报告，报告显示过去的上半年全球电信设备收入同比增...
Xilinx-AMD
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ttest
4年前更新
14次阅读
关注
美国全面限制中国芯片
10月8日，据外媒报道，美国商务部发布最新出口管制措施，将长江存储、中国科学院大学、上海理工大学等31家中国公司、机构列入所...
FPGA新闻资讯
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ttest
4年前更新
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关注
苹果 A16 芯片或沿用 A15 设计
在今年发布的苹果 14 系列手机中，仅有 iPhone 14 Pro / Max 搭载了苹果 A16 芯片。虽然采用了台积电 4nm 工艺，但无论是 Geekbe...
FPGA新闻资讯
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ttest
4年前更新
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芯片卖不动了！AMD业绩大降
美国超微公司10月7日大幅下跌，以每股58.44美元收盘，跌幅达13.87%，创2020年7月以来最低水平。该半导体公司发布了第三季度的初...
FPGA新闻资讯
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ttest
4年前更新
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FPGA学习-Verilog例化说明
Verilog例化说明1.什么是模块例化？为什么要例化？模块例化可以理解成模块调用。对于一个FPGA工程，通常是由一个顶层模块与多个...
FPGA新闻资讯
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ttest
4年前更新
403次阅读
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vivado FPGA编译问题 Register/Latch pins with no clock driven by root clock pin
今天在使用vivado进行时序检查时遇到了这样一个问题：Register/Latch pins with no clock driven by root clock pin，它是在no_c...
Xilinx-AMD
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ttest
3年前更新
194次阅读
关注
【FPGA】Synopsys vcs2018仿真问题汇总
1.重启后lisense问题
【问题原因】
可能是lmgrd服务不正常导致的，这边通过下面几个步骤解决 切换到root用户
su root 彻底关闭lm...
+2
FPGA常见问题
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