陈士双-ChipDebug
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陈士双等级-LV1-ChipDebug
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他很忙，正在debug...
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1年前
表情[ciya]-ChipDebug
评论于：在用Lattice Diamond 3.1软件过程中，遇到Synthesis exit by 9. Done: error code 9 怎么解决？
2年前
感谢感谢
评论于：推荐FPGA书籍下载
2年前
前辈，您好，我最近刚遇到这个问题，请问如何将MASTER SPI接口打开呢？是需要去看Flash手册对么？
@chipdebug评论于：LATTICE FPGA ECP5 程序可以通过 JTAG下载却不能下载到SPI FLASH里（未加密），请问怎么解决？
2年前
学习一下
评论于：请问LATTICE的 ECP5U FPGA的配置FLASH能否共享用来存储其它数据？
2年前
如何解决
评论于：如何避免错误“ERROR – pmi详细说明中的错误：pmi_ram_dp_0完成：错误代码2”在Lattice Diamond Tool中？
2年前
好哒好哒，感谢前辈，那我自己去查查资料优化一下吧，再次感谢前辈！
@MIPI Display评论于：Lattice FPGA 开发遇到问题
2年前
前辈您好，我查了一下，是从PLL IP出来的时钟违例，最高只能到96MHz，而我需要100MHz。像这种情况应该怎么办呢，怎么解决呢？谢谢您的回答
@MIPI Display评论于：Lattice FPGA 开发遇到问题
2年前
在哪看哪里时序为例了呀？yes之后就是这样的，这个时序违例对下板验证有没有影响呀？感谢大佬的回答。[图片]
@MIPI Display评论于：Lattice FPGA 开发遇到问题
2年前
学习了，感谢分享
评论于：通过SPI I2C IIC或GPIO模拟JTAG接口对LATTICE XO2 XO3 CPLD FPGA在线升级的开发笔记及源码分析
3年前
昂昂，您说的我都有，有时钟，这是简写的代码逻辑，主要是想说明一下这个逻辑。我不是初学者，这点我还是懂得表情[leiben]-ChipDebug
@ICMaker评论于：使用ChipWatcher抓到的波形与代码逻辑不符，有跳变。
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