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starkwang
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starkwang
4年前更新
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美国最新一轮半导体出口管制要点和细节
导语：最新情况显示，美国商务部工业和安全局（BIS）在其官网公布了一系列更全面的出口管制新规，欲限制中国获得先进计算芯片、...
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starkwang
4年前更新
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基于FPGA的直接扩频通信系统设计（附代码）
导读本篇适用于有一定通信基础的大侠，本篇使用的理论不仅仅是扩频通信。为了便于学习，本篇只把设计中使用的理论进行说明讲解。...
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FPGA CPLD资料源码分享
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starkwang
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手把手教你在Xilinx FPGA上搭建一个ARM Cortex-M3软核
之前介绍了ARM DesignStart计划，其中提到了Cortex-M1/M3 DesignStart FPGA版本支持Xilinx和国产Gowin平台，本篇文章将手把手教...
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starkwang
4年前更新
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如何私人定制一颗可在FPGA上运行的ARM内核SoC？ARM DesignStart计划了解一下！
什么是ARM DesignStart计划？2010年，ARM推出了ARM DesignStart计划，开放了1000+IP的物理版图，2015年开源Cortex-M0 IP评估版...
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FPGA新闻资讯
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starkwang
4年前更新
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【Vivado那些事儿】FPGA中逻辑资源和门的对应关系
在平时工作中，经常会听到哪个FPGA或者某个芯片包含了几百万门，每次听到这种数字，很多FPGA工程师都会一愣一愣的，因为大家...
Xilinx-AMD
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starkwang
4年前更新
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Xilinx FPGA开发工具 Vivado中的Elaborate是做什么的？
在Vivado的界面中，有个RTL ANALYSIS->Open Elaborated Design的选项，可能很多工程师都没有使用过。因为大家基本都是从Run S...
Xilinx-AMD
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starkwang
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Xilinx FPGA中BEL Site Tile FSR SLR分别指什么?
在Xilinx FPGA中，从底层到整个设备可以划分为6个层次： BEL Site Tile FSR SLR Device
下面我们从下到上依次来看一下各个定义。...
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Xilinx-AMD
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starkwang
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Xilinx FPGA 开发工具vivado如何快速找到schematic中的object
在Vivado中，可能由于某些逻辑输入悬空而导致Implementation的opt_design时会错，比如：
image-20220213154930313
报的错误...
Xilinx-AMD
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starkwang
4年前更新
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Xilinx FPGA中HP HR HD bank分别是什么用途
在开发FPGA绑定管脚时，经常会看到HP Bank、HR Bank和HD Bank，它们分别是什么意思？分别可以适用于哪些应用个？
...
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Xilinx-AMD
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starkwang
4年前更新
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基于FPGA的CAN总线控制器的设计（附代码）
导读CAN 总线（Controller Area Network）是控制器局域网的简称，是 20 世纪 80 年代初德国 BOSCH 公司为解决现代汽车中众多的控...
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FPGA CPLD资料源码分享
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starkwang
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两本FPGA自制CPU的书《CPU设计实战》《 CPU自制入门》分享
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starkwang
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Lattice推出了基于超低功耗FPGA up5k （iphone手机上曾用）的TinyML开发平台的开源方案
Lattice推出了基于超低功耗（iphone手机上曾用的up5k）FPGA的TinyML开发平台，并且开源了声音和人脸识别的开源方案。 视觉、...
Lattice-莱迪斯
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