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vishva
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精
FPGA通过MII RGMII接口进行UDP以太网数据通信的教程分享
FPGA RGMII GMII MII接口以太网通讯之以太网简介以太网是一种产生较早，使用相当广泛的局域网。其最初是由Xerox（施乐）公司创建...
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Anlogic-安路
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vishva
4年前更新
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PCIe架构概述（三）
PCIe专题 设备层简介PCIe定义了分层的架构，如图2-12所示。可以将这些层在逻辑上拆分为两个独立运行的部分，因为它们各自具有用...
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FPGA常见问题
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vishva
4年前更新
78次阅读
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PCIe架构概述（二）
不用通用时钟如前所述，PCIe Link不需要通用时钟(Common Clock)，因为它使用源同步模型，这意味着发送器将时钟提供给接收器以...
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FPGA常见问题
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vishva
4年前更新
119次阅读
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PCIe I/O时钟架构
导言：这篇为PCIe要提及的时钟类型作个小铺垫，可以大致作一个了解，想深入了解可以参考更加细致的文献。 三种基本的I/O架...
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FPGA常见问题
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vishva
4年前更新
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学习网站汇总
今天给大家推荐几个有趣的网站1、Z-library这个网站书多，想要搜的书基本都能找到（英文书），目前淘宝或者咸鱼卖的书很多都是出...
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FPGA CPLD资料源码分享
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vishva
4年前更新
150次阅读
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在VScode中自动生成Verilog仿真文件（Python）
一、实现功能1、可以自动创建文件夹2、根据Verilog文件自动生成测试文件模板（TB文件名字是）3、自动打开生成的文件4、自动调取m...
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FPGA常见问题
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vishva
4年前更新
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UCOSIII在ZYNQ上教程
在ZYNQ上移植UCOSIII版本：Vivado2018.3UCOS对Xilinx SDK适配的版本：Version1.45注意：目前这个是Micrium官网的最新版本，该版...
FPGA CPLD资料源码分享
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vishva
4年前更新
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异步FIFO（一）
在进入主题前，先介绍两个概念，亚稳态和格雷码
亚稳态的介绍：
对于采样电路中，一个信号在过渡到另一个时钟域时，如果仅仅用一...
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FPGA常见问题
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vishva
4年前更新
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异步FIFO（二）
上一篇文章主要讲解了FIFO的一些概念，这篇文章主要讲解VHDL代码。
代码一共有放在7个文件中，其中一个是测试文件，一个package...
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FPGA常见问题
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vishva
4年前更新
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流水线（一）
流水线由一系列的模块组成，这些模块称为流水线级。每一级执行整体任务的一部分，就像一条装配线上的一个工位，执行整体...
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FPGA常见问题
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vishva
4年前更新
161次阅读
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VHDL语法总结以及编码风格（二）
本教程使用最新的VHDL标准VHDL-2008，该标准可以提高设计人员的工作效率，并且适合用于数字设计入门课程。目前大多数编译器都支...
FPGA常见问题
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vishva
4年前更新
145次阅读
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关于VHDL和Verilog模块互相调用的问题
1、关于如何在VHDL模块调用一个Verilog模块
在VHDL模块声明一个要与调用的Verilog模块相同名称的元件（component），元件的名称...
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FPGA常见问题
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