LogiCORE IP RXAUI v2.1-Xs可在Marvel RXAUI 7系列时序仿真中看到-Xilinx-AMD社区-FPGA CPLD-ChipDebug

LogiCORE IP RXAUI v2.1-Xs可在Marvel RXAUI 7系列时序仿真中看到

描述

当Marvel RXAUI核心针对Virtex-7或Kintex-7器件时,可以在时序仿真中看到X. 问题是来自GTXE2_CHANNEL的RXOUTCLK在仿真开始时从0-> X转换。

要解决此问题,必须手动强制RXOUTCLK信号为0(通过仿真器特定命令),以使时序仿真工作。否则,X将通过仿真传播,导致仿真无法成功完成。

这个问题被安排在ISE 13.2软件的GTXE2_CHANNEL仿真模型中修复。

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