为什么在使用DPHY到CMOS IP V1.2时,我不能将GPIO/IOIO端口放置在BANG0上?lattice_wiki6年前发布270在交叉链路上的DPHY到CMOS IP版本1.2中,通过在输出侧添加ODR硬块来更新IP,以增强设计以支持超过150 MHz像素时钟。由于ODDR不在BAND0上,将IP的分配/放置在BANK1或BANG2上。 FPGAlattice莱迪思
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