请问一下 LATTICE FPGA的 input delay ,output delay。在那加?-Lattice-莱迪斯社区-FPGA CPLD-ChipDebug
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      • yinhk的头像-ChipDebugyinhk等级-LV1-ChipDebug作者0

        rmii是100M。不是ddr 普通管脚Io rgmii才是双沿，rmii是单沿。少了个g请看清楚

        7年前@chengfeng
    • ii1397的头像-ChipDebugii1397徽章-人气大使-ChipDebug等级-LV2-ChipDebug0

      参考iddr生成时的.v文件，里面有input delay 的用法

      7年前
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