串行RapidIO v5.1 – 完整硬件评估核心不断言“lnk_trdy_n”-Altera-Intel社区-FPGA CPLD-ChipDebug

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串行RapidIO v5.1 – 完整硬件评估核心不断言“lnk_trdy_n”

等级-LV1-ChipDebug

6年前发布

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问题描述

串行RapidIO内核在使用完整硬件评估许可证生成时，不会指示链路可以发送数据，因为它不会从PHY断言“lnk_trdy_n”。这可以在仿真和硬件中发生。

解决/修复方法

可以使用Serial RapidIO v5.1内核修补此问题。有关详细信息，请参阅（Xilinx答复31573）。

修订记录

2008年10月31日 – 初步发布

FPGA FPGA-CPLD SoCs xilinx 赛灵思

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