10.1 CORE Generator – 如果选择EDIF作为网表输出类型,则不会创建ChipScope内核Altera_wiki6年前发布10该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDSoCsxilinx赛灵思
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