9.2i EDK – 当我增加IPLB1 / DPLB1时钟频率时,设计无法运行Altera_wiki6年前发布10 问题描述 当我增加IPLB1 / DPLB1时钟频率时,设计无法运行。如何提高时钟频率并仍然使我的设计运行? 解决/修复方法 频率变化需要发生在MHS中的参数C_FASTEST_PLB_CLOCK中。 FPGAFPGA-CPLDSoCsxilinx赛灵思
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