9.1i时序 – PLL2DCM和DCM2PLL组件的反馈补偿不正确Altera_wiki6年前发布30 问题描述 在设计中,我有PLL2DCM和DCM2PLL组件,但通过这些组件的反馈延迟似乎是不正确的。 什么时候修好? 解决/修复方法 此问题已在最新的9.1i Service Pack中修复,可在以下位置获得: http://www.xilinx.com/xlnx/xil_sw_updates_home.jsp FPGAFPGA-CPLDSoCsxilinx赛灵思
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