为什么lattice FPGA 的参考设计里面，有的模块怎么只有端口，没有逻辑描述呢？-Lattice-莱迪斯社区-FPGA CPLD-ChipDebug
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    • chipdebug的头像-ChipDebugchipdebug徽章-创作大使-ChipDebug等级-LV3-ChipDebug超级版主0

      说明这个模块是blackbox
      是ip，网表文件，你看不到代码的。

      6年前
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