问题描述
以下错误是什么意思?
“错误:Xst:772 – ”属性未经授权:’succ’。“
以下是我的示例代码:
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type state_type是(s0,s1);
信号状态:state_type;
开始
进程(clk,重置)
开始
if(reset =’1’)然后
outdata <=’0′;
州<= s0;
elsif rising_edge(clk)然后
if(flag =’1’)然后
state <= state_type’succ(state);
其他
州<= s0;
万一;
万一 ;
结束过程;
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解决/修复方法
VHDL LRM不允许您以这种方式访问用户定义的属性;因此,错误消息是正确的。 LRM仅允许访问预定义属性的能力。
要消除此错误,您可以按如下方式编写代码:
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type state_type是(s0,s1);
信号状态:state_type;
开始
进程(clk,重置)
开始
if(reset =’1’)然后
outdata <=’0′;
州<= s0;
elsif rising_edge(clk)然后
if(flag =’1’)然后
州<= s1;
其他
州<= s0;
万一;
万一 ;
结束过程;
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