7.1i EDK-PLB / OPB DDR内核在Virtex-4器件中以100 MHz运行时无法满足时序要求Altera_wiki6年前发布20该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDSoCsxilinx赛灵思
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