模块化设计 – 如果不驱动顶级逻辑,如何推断顶级时钟的全局缓冲区(BUFG / IBUFG)?Altera_wiki6年前发布30该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDSoCsxilinx赛灵思
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