vivado中inout信号怎么观察？-Xilinx-AMD社区-FPGA CPLD-ChipDebug
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      • 52fpga的头像-ChipDebug52fpga徽章-人气大使-ChipDebug等级-LV2-ChipDebug0

        用寄存器打一拍再拉过去,这种内嵌的逻辑分析仪都直接采不了端口的，需要寄存器结点才行。

        6年前@52fpga
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