1.5 I VITEX PAR砂纸挂在ViTeX设计上。xilinx_wiki6年前发布10 描述 一个案例表明,砂矿在一夜之间就没有进展。确定这是因为设计包含超过2×16的信号。 解决方案 这个问题的解决方案包含在1.5 I服务包1中。详情在此服务包见HTTP://www. xLimx.com /TycDoSs/514HTM FPGAxilinx赛灵思
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