请问F2L15G100B内部集成晶振的究竟是100MHz还是50MHz,如何在例化PLL的时候指定为内部时钟?版主能否出一期例化内部时钟的帖子,详细说明一下例化PLL的基本流程,非常感谢!

chenmcu 
0 强烈建议出一个应用内部振荡器的一个手把手教程,我折腾一晚上没弄出来3年前

ICMaker
版主0 好,我在这个帖子的第一个回复,你看明白没?3年前@chenmcu

34af9uc 
0 看完更不会了...2年前@ICMaker

ICMaker
版主3 这个比较简单,就不专门出教程了,我给你贴代码进行说明。 我们提供的DEMO4同时提供了OSC和PLL的用法示便。
1. ELF2 器件包含一个 CMOS 环形振荡器, 环形振荡器的输出可以作为全局时钟的输入, 也可以作为 PLL的参考时钟。 环形振荡器在全局时钟路径上, 插入的可配置分频器可以对 OSC 的频率进行 1-128 任意整数分频。 可以动态配置分频系数, 不使用时可以关闭 OSC 以节省功耗。环形振荡器中心频率 287MHz, 芯片个体之间频率误差较高, 误差范围达到 30%。 即 每一片EF2之间的频率可能在这个频率附近30%范围内,但可以校准。
相较于上面主要是下面这几个端口的区别:
3年前已采纳

moriland 
0 您好,看demo程序里: .div(7'b000_0100), //分频系数。按这样算的话287/4=71.75M,而程序第一个led示例程序里,对系统时钟的描述是50M。如:input wire sys_clk , //系统时钟50MHz。这个50M是对的吗?多谢!3年前@ICMaker

ICMaker
版主0 是对的。3年前@moriland

moriland 
0
是50M还是71.75M?3年前@ICMaker

ICMaker
版主0 我做例程时的板子是50M,内部振荡器每片之间有30%误差,以示波器实测为准。其实里面大部分例程这个误差可以忽略3年前@moriland
回答8
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版主
1. ELF2 器件包含一个 CMOS 环形振荡器, 环形振荡器的输出可以作为全局时钟的输入, 也可以作为 PLL的参考时钟。 环形振荡器在全局时钟路径上, 插入的可配置分频器可以对 OSC 的频率进行 1-128 任意整数分频。 可以动态配置分频系数, 不使用时可以关闭 OSC 以节省功耗。环形振荡器中心频率 287MHz, 芯片个体之间频率误差较高, 误差范围达到 30%。 即 每一片EF2之间的频率可能在这个频率附近30%范围内,但可以校准。
相较于上面主要是下面这几个端口的区别:

是50M还是71.75M?