【提问】ERROR: Design’s sip pad number = 110, exceeds the limit 55.-Anlogic-安路社区-FPGA CPLD-ChipDebug
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    • ICMaker的头像-ChipDebugICMaker徽章-资深玩家-ChipDebug等级-LV3-ChipDebug版主0
      两种可能，要么你的管脚110个超过了芯片的管脚数。另一种可能，你的顶层有错误，重设顶层即可。
      5个月前已采纳
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