请大佬帮忙看看这个可能是什么原因导致的-Anlogic-安路社区-FPGA CPLD-ChipDebug
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    • D DQ的头像-ChipDebugD DQ等级-LV1-ChipDebug0
      也是一样的报错id 8023，找不到原因，加上内核就报该错误
      5个月前
      • Freddy的头像-ChipDebugFreddy徽章-初出茅庐-ChipDebug等级-LV1-ChipDebug作者0
        后面发现似乎是因为时序问题，整体的板子LUT使用到超过一定量后就会导致布局布线的失败
        5个月前@D DQ
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