4.1I核心发生器ViTEX和ViTEX II COREGEN在使用“添加焊盘”特性时为BUFG增加时钟信号。xilinx_wiki6年前发布40该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAxilinx赛灵思
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