从数据表:
加电过程中典型的I/O行为
当VCC和VCUAX达到满意水平时,内部功率复位(POR)信号被停用。POR信号停用后,FPGA核心逻辑变为激活。用户有责任确保所有VCCIO银行都具有有效的输入逻辑电平,以正确地控制所有对应用至关重要的I/O银行的输出逻辑状态。空白设备中的I/O引脚的默认配置是三态,具有弱的上拉到VCCIO。I/O引脚将保持空白配置,直到VCC、VCcAUX和VCCIO达到满意水平时,I/OS将接受用户配置的设置。VCC和VCcAUX为FPGA核心结构提供电源,而VCCIO将电源提供给I/O缓冲器。为了简化系统设计,同时提供一致和可预测的I/O行为,I/O缓冲器应该与FPGA核心结构一起被加电。因此,VCCIO电源应该在VCC和VCcAUX电源之前或与之一起供电。
所以回答这个问题:
IO将是活动的,但IO的状态将根据设备的配置方式而变化。如果IO是低驱动或下拉,它将在GND,但是,如果IO驱动高或拉高,它将前往Vccio,这是未定义的。
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