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jianwenjuan
他很忙，正在debug...
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jianwenjuan
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基于FPGA的cy7c68013a双向通信教程
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FPGA CPLD资料源码分享
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jianwenjuan
8年前发布
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LATTICE DDR3读写错误问题请教
现在有个DDR3读写错误的问题，原因是DATA数据线和DQS线不等长引起的，相差300~500mil，这主要是layout工程师疏忽导致了。我试过减低频率到300Mhz,仍然过几分钟会出错，如果是图像就1~2小时不定时会花屏。
附件的excel表里面的sheet1是左边的2片DDR3,线长正确...
Lattice-莱迪斯
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jianwenjuan
4年前更新
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关注
专业点灯二十年！详解STM32、FPGA、ARM点灯区别 ！
摘要：你点亮过多少板子的LED灯呢？有很多小伙伴留言说讲一下STM32、FPGA、Liunx他们之间有什么不同。不同点很多，口说无凭，今...
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FPGA常见问题
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jianwenjuan
4年前更新
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FPGA时序约束理论篇之时钟周期约束
时钟周期约束
时钟周期约束，顾名思义，就是我们对时钟的周期进行约束，这个约束是我们用的最多的约束了，也是最重要的约束...
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Xilinx-AMD
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jianwenjuan
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Xilinx芯片太贵，我选择国产替代！聊聊国产FPGA芯片选型
最近公司在进行FPGA国产化方案的准备工作，正在做市场的调研，也约了国内几家FPGA厂商的市场工程师来交流。关于FPGA，我算是半路...
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FPGA新闻资讯
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jianwenjuan
3年前更新
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Vivado 用户指南：逻辑仿真
仿真是在软件环境内对真实的设计行为进行仿真的进程。仿真有助于通过注入激励并观察设计输出来验证设计的功能。本章提供了仿真进...
Xilinx-AMD
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jianwenjuan
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FPGA工程师应如何挑选ADC和DAC
将具有信号处理功能的FPGA与现实世界相连接，需要使用模数转换器(ADC)或数模转换器(DAC)一旦执行特定任务，FPGA系统必须与现实世...
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Xilinx-AMD
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jianwenjuan
4年前更新
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通过 NoC 从 PS-APU 对 AXI BRAM 执行基本读写操作
本篇博文旨在演示如何通过 NoC 从 Versal™ 应用处理单元 (APU) 访问 AXI BRAM。 设计示例是使用 Vivado® 2020.2 版本创...
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Xilinx-AMD
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jianwenjuan
3年前更新
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关注
新环境、新起点，安路科技子公司成都维德青云乔迁揭牌仪式圆满举行
东风随春归，发我枝上花，春天是出发的季节，2023年2月27日，上海安路信息科技股份有限公司（下简称：安路科技）子公司成都维德...
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FPGA新闻资讯
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jianwenjuan
4年前更新
54次阅读
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如何理解HLS Block-level输入输出信号之间的时序关系
默认情况下，Vitis HLS会对待综合的C函数使用ap_ctrl_hs接口，这其实是一种握手方式。在这个接口中，我们会看到ap_start、ap_idl...
Xilinx-AMD
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jianwenjuan
4年前更新
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FPGA时序约束理论篇之时序路径与时序模型
时序路径
典型的时序路径有4类，如下图所示，这4类路径可分为片间路径（标记①和标记③)和片内路径（标记②和标记④）。
...
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Xilinx-AMD
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jianwenjuan
4年前更新
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FPGA需求旺盛，英特尔公布最新路线图
在过去几年，因为AI、数据中心和5G的火热，FPGA过去几年的关注度正在大增。正如英特尔数据中心与人工智能集团副总裁兼可编程解决...
FPGA新闻资讯
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