如果我的Verilog HDL设计文件在Case语句的单行上列出了多个案例,则只有第一个案例似乎在综合设计中实现。为什么?Altera_wiki6年前发布130该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDIntel/AlteraSoCs
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