警告:为输出I / O <PLL输出时钟>,PLL输出时钟<PLL输出时钟>指定的时钟周期必须大于或等于<时钟周期>。Altera_wiki6年前发布80该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDIntel/AlteraSoCs
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