如果您尝试使用低速时钟驱动PLL输入,Quartus II软件会错误地阻止Cyclone IV GX的连接Altera_wiki6年前发布70该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDIntel/AlteraSoCs
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