我可以使用低压差分信号(LVDS)信号作为常规锁相环(PLL)的输入和/或输出时钟吗?Altera_wiki6年前发布40该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDIntel/AlteraSoCs
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