为什么我的Stratix IV GX设计不能用VCCL / T / R = 1.2和VCCA在2.5V下编译?Altera_wiki6年前发布50该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDIntel/AlteraSoCs
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