为什么我会在MAX +PLUS®II软件中编译内存块时出现以下错误:“行<编号>:文件<文件路径>:不支持的Verilog HDL功能错误:内存”?-Altera-Intel社区-FPGA CPLD-ChipDebug

为什么我会在MAX +PLUS®II软件中编译内存块时出现以下错误:“行<编号>:文件<文件路径>:不支持的Verilog HDL功能错误:内存”?

MAX + PLUS II软件不支持Verilog HDL中的直接存储器实现。您应该在希望实现RAM或ROM的情况下使用Altera提供的功能。

有关如何在Verilog HDL中实现内存的更多信息,请在MAX + PLUS II软件中搜索帮助索引“实现RAM和ROM”或按名称搜索每个单独的内存功能。

注意:Altera建议在实例化这些宏功能时使用MegaWizard Plug-In Manager(从“文件”菜单访问)。

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