输入/输出缓冲器信息规范(IBIS)模型输入/输出(I / O)缓冲器中的ESD(静电放电)结构如何?Altera_wiki6年前发布20该帖子内容已隐藏,请评论后查看登录后继续评论登录注册FPGAFPGA-CPLDIntel/AlteraSoCs
没有回复内容