在估算仿真LVDS IO的片外功耗时,Stratix V,Arria V和Cyclone V器件的Early Power Estimator(EPE)工具是否存在已知问题?-Altera-Intel社区-FPGA CPLD-ChipDebug

在估算仿真LVDS IO的片外功耗时,Stratix V,Arria V和Cyclone V器件的Early Power Estimator(EPE)工具是否存在已知问题?

是的,有与早期功耗估算(EPE)工具版本12.1的已知问题和更早版本,为的Stratix®V,Arria®VCyclone®V器件,其中芯片外电源(外部电阻网络中消耗的功率)对于仿真LVDS,不计算I / O引脚。

解决/修复方法

计划在未来版本的EPE中修复。
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