如何在Cyclone V,Arria V和Stratix V器件的外部PLL模式下在Altera_PLL和ALTLVDS_RX或ALTLVDS_TX宏功能之间插入LVDS缓冲器?Altera_wiki6年前发布320该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGA-CPLDIntel/AlteraSoCs
没有回复内容