XILINX FPGA使用ise的rom核，modelsim独立仿真的结果数据不变，地址在变化，求教下哪块出了问题？-Xilinx-AMD社区-FPGA CPLD-ChipDebug
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    • chipdebug的头像-ChipDebugchipdebug徽章-创作大使-ChipDebug等级-LV3-ChipDebug超级版主0

      ROM初始化没成功
      Xilinx是用coe文件
      一行一个数据就可以了

      6年前
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