.
├── 1_1FxjTFJi_Vivado从此开始 Video_16_Virtual_Clock.pdf
├── 1_1THoye9T_Vivado从此开始 Video_4_Logic_Simulation_with_ModelSim.pdf
├── 1_36LnWPJq_Vivado从此开始 Video_28_UltraFast_design(6)_Manage_IP_Constraints.pdf
├── 1_4iUM77pX_Vivado从此开始 Video_8_Five_Most_Commonly_Used_Tcl_Commands.pdf
├── 1_5UMih9yV_Vivado从此开始 Video_9_Debug.pdf
├── 1_69AiumMc_Xilinx FPGA权威设计指南 Vivado 集成开发环境_1.pdf
├── 1_9bgQuzqu_Vivado从此开始 Video_38_TCL_Vivado_One_World_4.pdf
├── 1_AeQCg4fm_Vivado从此开始 Video_18_Setting_False_Path.pdf
├── 1_CCa7vI5L_Vivado从此开始 Video_19_XDC_Precedence.pdf
├── 1_DVPMC72D_Vivado从此开始 Video_35_TCL_Vivado_One_World_1.pdf
├── 1_EX7xvh25_Vivado从此开始 Video_32_UltraFast_Design(10)_Timing_Closure_Part2.pdf
├── 1_FS1S0wVd_Vivado从此开始 Video_1_Vivado_Design_Flow_Overview.pdf
├── 1_GHCfU2Zt_VIVADO从此开始__高亚军编著.pdf
├── 1_IBibxEny_Vivado从此开始 Video_31_UltraFast_Design(9)_Timing_Closure_Part1.pdf
├── 1_LG32bqtA_Vivado从此开始 Video_3_Logic_Simulation_with_XSim.pdf
├── 1_LUGNFNlw_Vivado从此开始 Video_39_TCL_Vivado_One_World_5.pdf
├── 1_NaiSc9be_Vivado从此开始 Video_12_Basic_Concept_and_Terminology_of_Timing_Analysis.pdf
├── 1_OjdZniz2_Vivado从此开始 Video_5_Synthesis.pdf
├── 1_Q2BgHKlg_Vivado从此开始 Video_29_UltraFast_Design(7)_Use_DRC_in_Vivado.pdf
├── 1_RA9ucsHL_Vivado从此开始 Video_37_TCL_Vivado_One_World_3.pdf
├── 1_SFFAVVRe_Vivado从此开始 Video_13_Create_Basic_Clock_Period_Constraint.pdf
├── 1_Uxbuf2v2_Vivado从此开始 Video_36_TCL_Vivado_One_World_2.pdf
├── 1_V1q8nyPh_Vivado从此开始 Video_40_TCL_Vivado_One_World_6.pdf
├── 1_W6WmhIvU_Vivado从此开始 Video_14_Setting_Input_Delay.pdf
├── 1_XWWNL8wM_Vivado从此开始 Video_23_UltraFast_Design(2)_Clocking.pdf
├── 1_YmDnjj6s_Vivado从此开始 Video_34_Vivado_IP_Integrator.pdf
├── 1_a9dTVyiQ_Vivado从此开始 Video_30_UltraFast_Design(8)_Impl_Strategies.pdf
├── 1_aDETMwLx_Vivado从此开始 Video_2_Designing_with_IP.pdf
├── 1_ce7FML3H_Vivado从此开始 Video_21_Design_Analysis_After_Synthesis_PartII.pdf
├── 1_dxqSoJy7_Vivado从此开始 Video_27_UltraFast_Design(5)_Defining_Clock_Groups.pdf
├── 1_fmQ2X5U2_Vivado从此开始 Video_24_UltraFast_Design(3)_RTL_Coding(1).pdf
├── 1_gI1Pk92D_Vivado从此开始 Video_22_UltraFast_Design(1)_Basic_Introduction.pdf
├── 1_hY9NH84a_Vivado从此开始 Video_41_TCL_Vivado_One_World_7.pdf
├── 1_iJHNEMmg_Vivado从此开始 Video_20_Design_Analysis_After_Synthesis_PartI.pdf
├── 1_jcuU2l8B_Vivado从此开始 Video_7_Incremental_Implementation.pdf
├── 1_mKa7GFUq_Vivado从此开始 Video_26_UltraFast_Design(4)_Timing_Constraint.pdf
├── 1_nNHJxTIi_Vivado从此开始 Video_6_Implementation.pdf
├── 1_oCLahDMQ_Vivado从此开始 Video_11_Some_Tips_About_Design_Flow.pdf
├── 1_rHCVpJwU_Vivado从此开始 Video_33_UltraFast_Design(11)_Power_Est_Opt.pdf
├── 1_sSb29O4Z_Vivado从此开始 Video_17_Setting_Multicycle_Path_Constraint.pdf
├── 1_yzyuSsud_Vivado从此开始 Video_10_IO_and_Clock_Planning.pdf
├── 1_zGa4BH0O_Vivado从此开始 Video_25_UltraFast_Design(3)_RTL_Coding(2).pdf
├── 1_zjbuYblH_Vivado从此开始 Video_15_Setting_Output_Delay.pdf
└── viviado从此开始高亚军视频教程
├── 1_1HP7SKsI_第38讲 Tcl在Vivado中的应用(4):嵌入自定义Tcl命令.mp4
├── 1_5idBlht3_第18讲 设置伪路径.mp4
├── 1_9DOc3AqS_第33讲 功耗估计和优化.mp4
├── 1_AMNXke3M_第6讲 实现.mp4
├── 1_Ca0j4Ppo_第30讲 UltraFast设计方法学(9):理解实现策略.mp4
├── 1_Ca1myGGz_第37讲 Tcl在Vivado中的应用(3):使用Hook Script.mp4
├── 1_DypVzviq_第20讲 综合后的设计分析(1):资源与扇出分析.mp4
├── 1_EeWiEOO8_新建文本文档.txt
├── 1_FulmZFm0_第1讲 Vivado设计流程及使用模式.mp4
├── 1_GQqSCHbx_第7讲 增量实现.mp4
├── 1_IfxRSsD3_第8讲 Vivado里最常用的5个Tcl命令.mp4
├── 1_KLzXjFTv_第34讲 利用Vivado IP Integrator进行设计开发.mp4
├── 1_LJg2zgx6_第10讲 输入输出和时钟规划.mp4
├── 1_MsoLJfUZ_第32讲 UltraFast设计方法学(11):时序收敛之10个时序收敛技巧.mp4
├── 1_TGL46rvo_第19讲 约束的优先级.mp4
├── 1_Tzsg8tiI_视频用素材.zip
├── 1_Uz3cgaLp_第39讲 Tcl在Vivado中的应用(5):使用Xilinx Tcl Store.mp4
├── 1_VL1nbUXL_第21讲 综合后的设计分析(2):时序分析.mp4
├── 1_XiJWSyTn_第36讲 Tcl在Vivado中的应用(2):定制报告.mp4
├── 1_ZTsWiFAE_第17讲 设置多周期路径约束.mp4
├── 1_ZqWtEZR4_第27讲 UltraFast设计方法学(6):定义时钟分组.mp4
├── 1_bKNilC1E_第29讲 UltraFast设计方法学(8):在Vivado中使用设计规则检查.mp4
├── 1_bybcUsol_第25讲 UltraFast设计方法学(4):RTL代码风格(2).mp4
├── 1_cuW0A03y_第23讲 UltraFast设计方法学(2):时钟.mp4
├── 1_d2IFQksS_第3讲 基于XSim的逻辑仿真.mp4
├── 1_diccyNBr_第12讲 时序分析中的基本概念和术语.mp4
├── 1_epPjGwqc_第16讲 虚拟时钟.mp4
├── 1_g7dN9Klw_第15讲 设置输出延时约束.mp4
├── 1_iRm1Ju93_第4讲 基于ModelSim的逻辑仿真(DEMO工程文件与第三讲一致.mp4
├── 1_ijy1cZZx_第26讲 UltraFast设计方法学(5):时序约束.mp4
├── 1_j8Q0phyG_第22讲 UltraFast设计方法学(1):初识UltraFast.mp4
├── 1_jRD3HV10_第5讲 综合的基本设置和综合属性.mp4
├── 1_k0QKTyAt_第9讲 编程与调试.mp4
├── 1_kx0jEts5_第28讲 UltraFast设计方法学(7):如何管理IP约束.mp4
├── 1_lQXAZrFQ_第2讲 用三个DEMO讲解如何在设计中使用IP.mp4
├── 1_lRA8OxKK_第11讲 与Vivado设计流程相关的一些技巧.mp4
├── 1_mfMpEXrK_第24讲 UltraFast设计方法学(3):RTL代码风格(1).mp4
├── 1_oOAeDxrm_第14讲 设置输入延时约束.mp4
├── 1_oQrIXEF6_第41讲 Tcl在Vivado中的应用(7):非工程模式下的设计流程管理.mp4
├── 1_qjZDbnNM_第40讲 Tcl在Vivado中的应用(6):工程模式下的设计流程管理.mp4
├── 1_rTImoScJ_第35讲 Tcl在Vivado中的应用(1):编辑网表.mp4
├── 1_thQrDj2Y_第31讲 UltraFast设计方法学(10):时序收敛之时序约束基本准则.mp4
└── 1_uSmrKm1x_第13讲 创建基本时钟周期约束.mp4