FPGA实现MMC(和衍生标准)主机控制器的开源代码-FPGA开源项目社区-FPGA CPLD-ChipDebug

FPGA实现MMC(和衍生标准)主机控制器的开源代码

进行中的工作 – 基本上可以正常工作但尚未完成稳定版本。

特征
  • 1 位 / 4 位数据模式。
  • 大扇区缓冲区(用于多个扇区读取或写入)。
  • AXI-4 DMA。
当前bugs
  • DMA:不支持卡写入模式(仅作为从卡读取的功能)。
  • 鲁棒性:目前不检查传入响应的 CRC7 / CRC16。
  • 写入:多扇区写入支持不正确。
  • AXI:AWVALID 和 WVALID 上的可疑组合路径。
测试

在以下 FPGA 板上练习;

  • Digilent Arty A7(赛灵思 Artix 7)
  • LambaConcept ECPIX-5(莱迪思 ECP5)
Register Map
Offset Name Description
0x00 MMC_CONTROL [RW] Transfer Control Register
0x04 MMC_CLOCK [RW] Clock Configuration Register
0x08 MMC_STATUS [R] Transfer Status Register
0x0c MMC_CMD0 [RW] Command (first 32-bits)
0x10 MMC_CMD1 [RW] Command (subsequent 16-bits)
0x14 MMC_RESP0 [R] Response Register
0x18 MMC_RESP1 [R] Response Register
0x1c MMC_RESP2 [R] Response Register
0x20 MMC_RESP3 [R] Response Register
0x24 MMC_RESP4 [R] Response Register
0x28 MMC_TX [W] Data Transmit Register
0x2c MMC_RX [R] Data Receive Register
0x30 MMC_DMA [RW] DMA Target
Register: MMC_CONTROL
Bits Name Description
31 START Start transfer.
30 ABORT Abort transfer.
29 FIFO_RST FIFO reset.
15:8 BLOCK_CNT Number of blocks (0=1, 1=2, …)
5 WRITE Data write operation
4 DMA_EN DMA port enable
3 WIDE_MODE 4-bit data mode.
2 DATA_EXP Wait for data
1 RESP136_EXP Wait for response (R2).
0 RESP48_EXP Wait for response (~R2).
Register: MMC_CLOCK
Bits Name Description
7:0 DIV Clock divider
Register: MMC_STATUS
Bits Name Description
8 CMD_IN Command input line state
7:4 DAT_IN Data input line state
3 FIFO_EMPTY FIFO empty.
2 FIFO_FULL FIFO full.
1 CRC_ERR CRC error
0 BUSY Transfer active
Register: MMC_CMD0
Bits Name Description
31:0 VALUE Command data.
Register: MMC_CMD1
Bits Name Description
15:0 VALUE Command data.
Register: MMC_RESP0
Bits Name Description
31:0 VALUE Response data.
Register: MMC_RESP1
Bits Name Description
31:0 VALUE Response data.
Register: MMC_RESP2
Bits Name Description
31:0 VALUE Response data.
Register: MMC_RESP3
Bits Name Description
31:0 VALUE Response data.
Register: MMC_RESP4
Bits Name Description
31:0 VALUE Response data.
Register: MMC_TX
Bits Name Description
31:0 DATA Data
Register: MMC_RX
Bits Name Description
31:0 DATA Data
Register: MMC_DMA
Bits Name Description
31:0 ADDR Start address

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