首页
交流分享
积分规则
创作分成
隐私政策
免责声明
电子工程师在线工具
New
发布
开通会员
开通黄金会员
全站资源约8折购买
部分内容免费阅读
VIP用户专属版块
开通黄金会员
开通钻石会员
全站资源约6折购买
部分内容免费阅读
VIP用户专属版块
一对一技术指导
开通钻石会员
开通会员 尊享会员权益
登录
注册
找回密码
首页
交流分享
积分规则
创作分成
隐私政策
免责声明
电子工程师在线工具
New
开通会员 尊享会员权益
登录
注册
找回密码
分享
标签
PCIe
帖子 81
阅读 1547
PCI-Express(peripheral component interconnect express)是一种高速串行计算机扩展总线标准。
帖子数
81
阅读量
1547
chipdebug
2年前更新
17次阅读
关注
PCIe扫盲——TLP路由(Routing)基础
PCIe
首先来分析一个例子,如下图所示:
当包(Packet)到达Switch的输入端口(Ingress Port)时,端口首先会检查包是否有错误,然后...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
7次阅读
关注
PCIe扫盲——Base Limit寄存器详解
PCIe
上一篇文章介绍了Type0型配置空间Header中的BAR的作用和用法,但是PCIe中的桥设备(Switch和Root中的P2P)又是如何判断某一请求...
+2
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
49次阅读
关注
PCIe扫盲——基地址寄存器(BAR)详解
PCIe
基地址寄存器(BAR)在配置空间(Configuration Space)中的位置如下图所示:
其中Type0 Header最多有6个BAR,而Type1 Header最...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
8次阅读
关注
PCIe扫盲——Type0 Type1 型配置请求
PCIe
前面的文章中介绍过有两种类型的配置空间,Type0和Type1,分别对应非桥设备(Endpoint)和桥设备(Root和Switch端口中的P2P桥)...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
13次阅读
关注
PCIe扫盲——一个Memory Read操作的例子
PCIe
前面的一系列文章简要地介绍了PCIe总线的结构、事务层、数据链路层和物理层。下面我们用一个简单地的例子来回顾并总结一下。
如...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
27次阅读
关注
PCIe扫盲——BDF与配置空间
PCIe
前面的文章中介绍过,每一个PCIe设备可以只有一个功能(Function),即Fun0。也可以拥有最多8个功能,即多功能设备(Multi-Fun)...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
8次阅读
关注
PCIe扫盲——PCIe总线数据链路层入门
PCIe
前面的文章介绍过,数据链路层(Data Link Layer)主要进行链路管理(Link Management)、TLP错误检测,Flow Control和Link功耗...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
3次阅读
关注
PCIe扫盲——PCIe总线事务层入门(三)
PCIe
PCIe总线设计之初,充分考虑到了音频和视频传输等这些对时间要求特别敏感的应用。为了保证这些特殊应用的数据包能够得到优先发送...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
8次阅读
关注
PCIe扫盲——PCIe总线事务层入门(二)
PCIe
前面的文章介绍了TLP的几种类型以及TLP的包结构。这篇文章来详细地聊一聊Non-Posted Transaction(包括Ordinary Read、Locked Re...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
12次阅读
关注
PCIe扫盲——PCIe总线事务层入门(一)
PCIe
在介绍事务层之前,首先简单地了解一下PCIe总线的通信机制。假设某个设备要对另一个设备进行读取数据的操作,首先这个设备(称之...
+2
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
9次阅读
关注
PCIe扫盲——PCIe总线体系结构入门
PCIe
和很多的串行传输协议一样,一个完整的PCIe体系结构包括应用层、事务层(Transaction Layer)、数据链路层(Data Link Layer)和...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
9次阅读
关注
PCIe扫盲——PCIe总线基本概念
PCIe
PCIe总线的提出可以算是代表着传统并行总线向高速串行总线发展的时代的到来。实际上,不仅是PCI总线到PCIe总线,高速串行总线取...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
17次阅读
关注
PCIe扫盲——PCI-X总线基本概念
PCIe
PCI-X总线在PCI总线的基础上发展而来,其在软件和硬件层面上都是兼容PCI总线的,但是却显著的提高了总线的性能。也就是说PCI-X的...
+1
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
13次阅读
关注
PCIe扫盲——PCI总线中的Reflected-Wave Signaling
PCIe
PCI Spec规定了每个PCI总线上最多可以连接多达32个PCI设备,但是实际上却远远达不到32个,33MHz的32位PCI总线一般只能连接10到12...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
6次阅读
关注
PCIe扫盲——66MHz的PCI总线与其技术瓶颈
PCIe
为了能够取得更高的带宽,新版本的PCI Spec将PCI总线提高到了64-bit并将频率提高到了66MHz,最高支持533MB/s。下图描述的是一个...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
14次阅读
关注
PCIe扫盲——PCI总线的地址空间分配
PCIe
PCI总线具有32位数据/地址复用总线,所以其存储地址空间为2的32次方=4GB。也就是PCI上的所有设备共同映射到这4GB上,每个PCI设备...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
8次阅读
关注
PCIe扫盲——PCI总线配置周期产生和配置寄存器
PCIe
上一篇文章中也是说到了,I/O Address Space的空间很有限(64KB),所以一般在I/O Space中都有两个寄存器,第一个指向要操作的内...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
9次阅读
关注
PCIe扫盲——PCI总线的中断和错误处理
PCIe
PCI总线使用INTA#、INTB#、INTC#和INTD#信号向处理器发出中断请求。这些中断请求信号为低电平有效,并与处理器的中断控制器连接...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
21次阅读
关注
PCIe扫盲——PCI总线的三种传输模式
PCIe
本文来简单地介绍一下PCI Spec规定的三种数据传输模型:Programmed I/O(PIO),Peer-to-Peer和DMA。
三种数据传输模型的示意图...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
25次阅读
关注
PCIe扫盲——一个典型的PCI总线周期
PCI总线是一种地址和数据复用的总线,即地址和数据占用同一组信号线AD。PCI总线的所有信号都与时钟信号同步,及所有的信号的变化...
FPGA CPLD资料源码分享
评分
回复
分享
chipdebug
2年前更新
8次阅读
关注
PCIe扫盲——PCI总线基本概念
PCI是Peripheral Component Interconnect(外设部件互连标准)的缩写,它曾经是个人电脑中使用最为广泛的接口,几乎所有的主板产品...
FPGA CPLD资料源码分享
评分
回复
分享
上一页
1
2
3
在手机上浏览此页面
登录
没有账号?立即注册
邮箱
验证码
发送验证码
记住登录
账号密码登录
登录
用户名/手机号/邮箱
登录密码
记住登录
找回密码
|
免密登录
登录
注册
已有账号,立即登录
设置用户名
手机号或邮箱
验证码
发送验证码
设置密码
重复密码
注册
注册即表示同意
用户协议
、
隐私声明
欢迎光临!
ChipDebug入站需知
本站无广告也无付费项目,如发现帐号发垃圾帖或评论的一律封号!
ChipDebug是一个芯片开发调试分享网站
欢迎您的到来!如果您没有帐户请先点击下方按钮进行
注册
登录
注册
找回密码
积分规则