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Harman
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Harman
4年前更新
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请教lattice fpga功能异常，加入reveal debug 后反而正常了
现在碰到一个问题，想咨询一下。fpga功能异常，加入reveal debug 功能后反而正常了，以前碰到过类似的，xilinx 加chipscope 才运行正常的情况，后来发现是之前时序约束没做好,但现在时序约束都做了
Lattice-莱迪斯
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Harman
3年前更新
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AIE(12)—AI Engine架构概览
AI Engine阵列是由一系列的AI EngineTile构成。每个AI Engine Tile包含一个AI Engine，一个存储单元和一个互连单元，如下图所示...
Xilinx-AMD
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Harman
4年前更新
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Xilinx FPGA AI开发工具 AIE(3)—理解AIE编程中的Kernel
在上一篇文章中我们介绍了AIE中的graph。graph通常在一个.h文件中描述，可认为是AIE应用工程的顶层文件，位置仅次于仿真文件，我...
Harman
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https://chipdebug.com/forum-post/52660.html https://chipdebug.com/forum-post/52681.html
Xilinx-AMD
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Harman
3年前更新
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AIE(1)—创建一个简单的AIE工程
对于Versal，我们从系统角度看，可将其分为3个Domain：AIE、PS和PL，如下图所示。如果要运行一个AIE的应用，绝大多数情况下，这3...
+10
Xilinx-AMD
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Harman
4年前更新
137次阅读
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xilinx FPGA 开发工具 Vivado log文件包含什么信息（1）
无论是综合（Synthesis）还是实现（Implementation），Vivado在运行过程中都会生成日志文件。文件名为runme.log。这个文件位于相...
+8
Xilinx-AMD
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Harman
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Xilinx FPGA AI开发工具 AIE(14)—AI Engine API简介
起初，在Xilinx推出包含AI Engine的FPGA芯片Versal AI Core时，针对AI Engine的编程方式为Intrinsics。Intrinsics可理解为已经被...
Xilinx-AMD
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Harman
3年前更新
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AIE(4)—AIE编译器和X86模拟器
在之前的文章中，我们介绍了如何在Vitis下创建一个AIE工程以及AIE工程中的graph和kernel等基本概念，回顾一下，我们可以看到AIE...
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Xilinx-AMD
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AIE(6)—用Vitis Analyzer查看AIE编译结果
在上一篇文章中我们介绍了运行AIE编译器编译graph和kernel相关代码，目标是AIE仿真器。这篇文章我们将重点介绍如何用Vitis Analy...
+6
Xilinx-AMD
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Harman
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Xilinx FPGA AI开发工具AIE(8)—创建一个包含PL/PS/AIE的Vitis工程（1）
打开Vitis例子工程 首先，按照下述步骤打开Vitis例子工程：第一步：打开Vitis 2021.2，设置好workspace第二步：在Welcome页...
+10
Xilinx-AMD
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Harman
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AIE(5)—针对AI Engine进行编译
在上一篇文章中，我们介绍了针对x86处理器编译AIE并执行功能仿真。在本篇文章中，我们将介绍针对AI Engine模型编译AIE并执行仿真...
+7
Xilinx-AMD
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Harman
3年前更新
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AIE(7)—理解Runtime Ratio
在描述graph的.h文件中，我们需用对每个kernel设置runtime ratio，如下图所示代码第26行和第27行。通常这个值介于0和1之间，表征...
+3
Xilinx-AMD
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Harman
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AIE(9)—创建一个包含PL/PS/AIE的Vitis工程（2）
在前一篇文章中我们介绍了如何创建一个包含PL/PS和AIE三个domain的Vitis工程，接下来我们介绍一下如何编译该工程。 打开文件ful...
+9
Xilinx-AMD
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