为PCI Express AVMM-DMA核心使用硬核时,为什么会看到数据损坏或未完成的描述符?-Altera-Intel社区-FPGA CPLD-ChipDebug

为PCI Express AVMM-DMA核心使用硬核时,为什么会看到数据损坏或未完成的描述符?

由于PCI®Express核心的硬IP的AVMM-DMA变体存在问题,您可能会看到数据损坏或描述符永远不会完成(永远不会设置完成位)。这仅影响使用外部DMA描述符控制器的设计,内部实例化控制器设计功能齐全。

这个问题可能是零星的,并且可能仅在大量描述符背靠背编程时才会发生。

解决/修复方法

作者注:这可以解决,但需要在Quartus安装中编辑一个文件,我认为我们不建议这样做。

此行为是由dma_rd_master和dma_wr_master描述符编程接口的就绪延迟设置不正确引起的。

这些在用户指南中的“带有外部DMA描述符控制器的Avalon-MM DMA框图”中的rd_ast_rxrd_ast_tx接口显示,具体为“描述符控制器到读取(写入)的描述符指令接口中的RdAstRxReady_o,WrAstTxReady_o” DMA引擎“表。

当正确的值应为3时,这些信号的就绪延迟被错误地设置为0。

计划在Quartus®Prime软件的未来版本中修复此问题。

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