错误:有设计中的真差分输出缓冲区,但仅限于此器件上提供真差分输出缓冲区位置。Altera_wiki6年前发布40该帖子内容已隐藏,请评论后查看登录后继续评论登录注册FPGAFPGA-CPLDIntel/AlteraSoCs英特尔/阿尔特拉
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