错误:pcie_hard_ip_0_pcie_bfm_0:altera_pcie_bfm_qsys不支持VHDL Simulation的生成。生成适用于:Verilog Simulation,Quartus SynthesisAltera_wiki6年前发布80该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDIntel/AlteraSoCs英特尔/阿尔特拉
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