具有322 MHz参考时钟的低延迟40-100GbE IP内核目标Stratix V器件具有错误的RX MAC时钟频率Altera_wiki6年前发布90该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGAFPGA-CPLDIntel/AlteraSoCs英特尔/阿尔特拉
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