我应该选择哪个选项来生成具有与Model Sim兼容的时序信息的VHDL输出文件? (MAX + PLUS II)Altera_wiki6年前发布10 您应该从MAX + PLUS II编译器中选择SDF输出文件版本2.1(VITAL) (接口菜单 – > VHDL网表编写器设置)。 FPGA-CPLDIntel/AlteraSoCs英特尔/阿尔特拉
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