错误:(vsim-3058)Verilog端口’scaninb’的宽度(1)与其VHDL连接的数组长度(8)不匹配Altera_wiki6年前发布200 如果在Quartus®IIv13.0中生成Altera®乘法加法器,您可能会看到此错误。 解决/修复方法 Quartus II 14.0及更高版本中已修复此问题。 FPGA-CPLDIntel/AlteraSoCs英特尔/阿尔特拉
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