错误(169224):当器件上使用VREF引脚时,I / O bank中每个VCCIO和接地对的输出和双向引脚太多Altera_wiki6年前发布90该帖子内容已隐藏,请登录后查看登录后继续查看登录注册FPGA-CPLDIntel/AlteraSoCs英特尔/阿尔特拉
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