为什么在Fitter阶段会出现以下错误:Termination logic选项设置为Differential for input,但I / O标准不支持设置?-Altera-Intel社区-FPGA CPLD-ChipDebug

为什么在Fitter阶段会出现以下错误:Termination logic选项设置为Differential for input,但I / O标准不支持设置?

从Quartus Prime软件版本16.0开始,当设计实例化16.0及更高版本中生成的外部存储器接口IP时,您可能会在Fitter阶段看到此错误消息: PLL参考时钟引脚名称 >,但I /不支持设置O标准< 单端I / O标准 >

解决/修复方法

要解决此错误,可以执行以下操作之一: set_instance_assignment -name INPUT_TERMINATION OFF -to < PLL参考时钟引脚的名称 >
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