当通过执行“run”命令在ModelSim®软件中仿真我的Nios™嵌入式处理器2.0版VHDL设计时，为什么会出现“超出范围”错误？ （Nios 2.0，SOPC Builder 2.5）-Altera-Intel社区-FPGA CPLD-ChipDebug
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