ALTERA_FP_MATRIX_MULT IP核的Verilog HDL仿真模型会产生错误的仿真Altera_wiki6年前发布230 由于ALTERA_FP_MATRIX_MULT IP内核的Verilog HDL仿真模型存在问题,因此仿真输出不正确。此问题仅影响NCSim软件。 解决/修复方法 使用VHDL仿真模型 FPGA-CPLDIntel/AlteraSoCs英特尔/阿尔特拉
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