用于PCIe IP内核的Arria V GZ和Stratix V硬IP不会在CBB测试中循环通过Gen1-Gen3数据速率Altera_wiki6年前发布70该帖子内容已隐藏,请评论后查看登录后继续评论登录注册FPGA-CPLDIntel/AlteraSoCs英特尔/阿尔特拉
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